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关于E203 test_mode信号

什么一下信号情况情况下下接

最近在研究E203的RTL代码，有一个信号是test_mode，开源代码里面给了个常量0。请教一下各位大佬，这个信号是干啥用的？在什么情况下接0，什么情况下接1？请大佬赐教，谢谢~

来自：开源蜂鸟E203版块（XQS0927发表于：1718 天前）

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NICE接口和EAI接口

e203 模块 CMD 一个信号 NICE

一、存储器读写字节数NICE接口在存储器请求通道多了一个nice_icb_cmd_size信号，取消了原来的eai_icb_cmd_wmask。从e203_lsu_ctrl.v中的相关代码可以得知，c...

来自：全国大学生集成电路创新创业大赛版块（leon发表于：1377 天前）

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【求助】关于总线接口的问题（icb_cmd_read）

还是内部这个信号 icb 写呢

icb总线中，其信号icb_cmd_read是输入信号，但是他的内部是怎么判断这个信号是读还是写呢？

来自：开源蜂鸟E203版块（突刺咸鱼发表于：1317 天前）

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【分享】利用Verdi调试协处理器的实现步骤

处理器文件测试协处信号波形

大家好，我们是华芯极客队，报名编号是CICC3877，本次给大家介绍的是利用Verdi调试协处理器的实现步骤。有时为了观察协处理器运行情况，需要查看协处理器接口的信号波形，此时可以用Verdi来查看主...

来自：全国大学生集成电路创新创业大赛版块（月影，花香，风满楼发表于：1296 天前）

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【分享】 DES算法分享——DES控制模块架构

模块输出信号控制状态 DES

队伍编号：CICC1905 团队名称：青稞战队本设计的DES控制模块是使用有限状态机（FSM）实现的。FSM的现态是边沿触发的，根据rst_n复位信号和start启动信号进行现态的赋值；次态逻辑设...

来自：全国大学生集成电路创新创业大赛版块（发表于：1290 天前）

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【分享】 DES轮密钥产生模块结构设计

输出信号 DES 密钥通器一选

队伍编号：CICC1905 队伍名称：青稞战队DES轮密钥产生模块中的置换选择PC-1、循环左移、置换选择PC-2均采用assign语句实现，配合一个二选一选通器和一个十六选一选通器实现。其...

来自：全国大学生集成电路创新创业大赛版块（发表于：1290 天前）

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【分享】 DES加密运算模块结构设计

结果信号加密 DES 运算置换

队伍编号：CICC1905 队伍名称：青稞战队DES加密运算模块使用纯组合逻辑完成初始IP置换、E扩展置换、P盒置换和初始IP逆置换的设计。加以一个以keysel为选通信号的二选一选通器选择置...

来自：全国大学生集成电路创新创业大赛版块（发表于：1290 天前）

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【分享】利用蜂鸟E203搭建SoC【3】——NICE接口配置

信号 NICE 等线状态端口

队伍编号：CICC1842 针对RV所特有的扩展指令，e203使用NICE接口进行通信，以下对自定义指令情况下的NICE各个端口配置进行详细介绍。由于NICE模块的输入端口由CPU发送相关信号，因此仅...

来自：全国大学生集成电路创新创业大赛版块（Z发表于：1290 天前）

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【分享】分享使用e203驱动OV5640

数据寄存器模拟信号数据线 I2C

本队伍号为CICC3152上一篇讲述如何将axi总线引出，本组使用axi_gpio ip模拟SDA,SCL信号，在芯来sdk中建工程，定义写寄存器，读寄存器函数有必要介绍一下AXI_GPIO及如何使用...

来自：开源蜂鸟E203版块（悟空发表于：1290 天前）

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【分享】时钟移项电路加速模块的设计

数据模块 quot 信号时钟逻辑

团队名称：Great Bee 大家好，本团队此次分享的内容为时钟移相电路加速模块的设计。数据接收时由于传感器输出的LVDS信号，即低压差分信号，LVDS信号是利用一个低压差分对的相对关系来表...

来自：中国研究生创芯大赛版块（发表于：1271 天前）

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【分享】 RVMCU课堂「22」: 手把手教你玩转RVSTAR—ADC应用篇

开发 IDE 数字信号 ADC 电位器

ADC（Analog to Digital Converter，模数转换器）是指将连续变化的模拟信号转换为离散的数字信号的电子器件。ADC可以将真实世界的模拟信号，例如温度、压力、声音等，转换成更容...

来自：GD32VF103 MCU版块（Fish发表于：1265 天前）

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【分享】 RVMCU课堂「23」: 手把手教你玩转RVSTAR— DAC应用篇

LED 模拟数字信号旋钮亮度

上期内容我们介绍了可以将模拟信号转化为数字信号的ADC，其实还有另一种与ADC相对的，能够将数字信号转化为模拟信号输出的外设——DAC（Digital to Analog Converter，数字/模...

来自：GD32VF103 MCU版块（Fish发表于：1257 天前）

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【分享】 verdi中trace信号的方法

驱动选择信号波形波形图 trace

一、队伍介绍队伍名称：东莞庄路三缺二队伍编号:CICC1399。大家好，本篇是我们队伍的第四篇分享，主要介绍一下在verdi中trace信号的几种方法。水平有限，如有错误，欢迎大家批评指正。二、具...

来自：全国大学生集成电路创新创业大赛版块（发表于：1248 天前）

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【分享】 MCU200T的SPIFLASH驱动程序的单条指令设计

指令设计需要我们信号时钟

大家好，我们队名是大黄蜂队，队伍编号CICC1948 ,此帖将简要介绍MCU200T的SPIFLASH驱动程序的单条指令设计，以READ ID指令为例。我们要在MCU200T完成图像处理或者音频处理...

来自：GD32VF103 MCU版块（FREE-LOOP发表于：1246 天前）

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【分享】 MCU200T的SPI FLASH驱动程序的单条指令设计

指令设计需要我们信号时钟

大家好，我们队名是大黄蜂队，队伍编号CICC1948 ,此帖将简要介绍MCU200T的SPIFLASH驱动程序的单条指令设计，以READ ID指令为例。我们要在MCU200T完成图像处理或者音频处...

来自：全国大学生集成电路创新创业大赛版块（FREE-LOOP发表于：1246 天前）

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【分享】基于FPGA平台的蜂鸟E203 JTAG debug出错问题的解决思路

e203 JTAG debug 信号 DO 因此

大概花了三天时间完成了蜂鸟E203 SOC在zynq7100 FPGA的移植工作，并完成了hello world程序的在线debug调试。蜂鸟E203的移植在网上有大把的demo,其中bit文件固化存...

来自：开源蜂鸟E203版块（发表于：1225 天前）

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【求助】求助蜂鸟E203 V2的FPGA实现之后，上板测试想用ila抓取内部信号，没有波形

模块添加内部信号 IFU ila

RISC-V 蜂鸟E203平台在黑金的AX7050上移植搭建，想查看IFU模块的内部信号，于是调用ila查看，却发现没有任何波形输出，FPGA实现是可以正常run编译之后可执行文件的。图1是用ila抓...

来自：全国大学生集成电路创新创业大赛版块（发表于：1151 天前）

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【求助】蜂鸟e203顶层信号含义

e203 蜂鸟总线信号顶层 sysmem

在蜂鸟e203中，顶层信号中“sysmem”总线是做什么用的

来自：开源蜂鸟E203版块（发表于：1030 天前）

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【分享】关于pmu_padrst、pum_paden连上led灯不亮调试方法

LED 开发信号定义类型 inout

在fpga顶层system.v中，我们可以看到，这三个信号，定义为inout类型，但是并没有单独定义IOBUF。在vivado中，连接的管脚的信号一般都会自动添加OBUF或IBUF。但是对于inout...

来自：全国大学生集成电路创新创业大赛版块（发表于：1019 天前）

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【分享】板子的差分时钟如何正确地转化为单端

方法信号时钟差分单端转为

队名：newbird队号：CICC2469 本组使用的板子是GENESYS2，输入时钟信号为差分时钟信号，而E203使用的时钟都是单端的，所以需要将差分时钟信号转为单端。而通过网络检索，可以得到以下的...

来自：全国大学生集成电路创新创业大赛版块（发表于：1008 天前）

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【求助】求助：Nuclei-master.xdc中的信号和soc顶层文件对应不上

文件里面比如信号不到 top

xdc文件中信号跟top里面对不上是为什么呢，比如这个gpioA，在top文件中没有还有一些别的信号，在top文件里面找不到，比如：

来自：开源蜂鸟E203版块（发表于：998 天前）

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【分享】蜂鸟E203内核中断管理模块sirv_plic_man代码解读

中断 IRQ 信号 icb 优先级请求

这段代码是一个 System-level Interrupt Request (PLIC) 控制器的 Verilog HDL 模块，它用于管理来自多个源的中断请求并将它们分派给处理器的中断请求线。PL...

来自：开源蜂鸟E203版块（妖刀村雨发表于：575 天前）

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【求助】蜂鸟E203v2的引脚绑定文件

fpga 这些找到源码信号 rst

想请问一下这些绑定引脚的信号在哪个模块？在源码中没有找到fpga_rst mcu_rst这些信号

来自：开源蜂鸟E203版块（riscv发表于：438 天前）

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