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NICE_demo生成.verilog后在VIVADO仿真不正确
开源蜂鸟E203 作者 发布于 2022-04-15 20:01(1638 天前) 3910 浏览

按照链接https://www.rvmcu.com/community-topic-id-386.html
想观察波形变化来学习NICE的写法。
在NECLEI STUDIO中生成了.verilog,之后在VIVADO中读取,仿真,没有输出相应的计算结果,而是ITCM的一些数据,如下图。
图片alt
请问如果想让它输出正常计算结果应该如何调整呢。

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