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使用了自己的FPGA开发板，通过普通的IO实现jtag调试器连接，FPGA顶层的引脚如下图所示其中qspi引脚用的是FPGA固化程序用的flash而下载器则是通过淘宝上购买的一个sispeed USB...
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程序bd
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nucleistudio 文档里面有个高亮的字符串，点击鼠标不会显示闪烁的光标，无法输入字符和文字，帮忙看看怎么解决。
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使用的是DDR200T，它板载了512M DDR3L的内存，跑的的一个UX600的demosoc.修改gcc_demooc_ddr.ld，让LENGTH长度之和超过256M，比方这里是257M，系统就...
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蜂鸟e203在实现多周期乘法的时候，复用了ALU共享数据通路的加法器。如果乘法的后级指令（下一指令）也需要用到ALU中的加法器。这个地方如何解决它们的资源冲突？暂时没想通这个地方，希望有人解答一下，谢...
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大家好， 目前团队完成了一个简单RISC-V架构rv32im内核，布置在了小脚丫板子的MAX10上边。当下能够找到的RISC-V架构完成Micropython都是依赖配套的操作系统，例如...
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我手上有一张DDR200T的开发板，板载了一块512M的SDRAM内存，板子烧了一个UX600的demosoc，我是要在这个板子跑RT-Thread。要是想使用这块SDRAM应该怎么做呢？应该不是只修...
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是通过直接修改rtl代码，还是通过其他软件？
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e203的乘法指令需要16个周期来执行，如果有以下代码：mul x7,x8,x9;add x10,x7,x11;后一条指令对前一条指令有数据依赖，如果不停滞流水线，后一条指令怎么才能得到正确的结果。我...
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在选择硬件为e203的情况下，NuleciStudio IDE 识别不了浮点数。就是说float a1.0;打印a，a显示不出来。是因为编译器不支持浮点数吗？如果不支持，怎么没修改呢？
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蜂鸟e203的system文件修改后出现时序不符合要求的问题，但是仿真和上板能正常跑通。有没有大佬知道什么问题，错误如下图所示。
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队伍编号：CICC2136 摘要本文将分享如何使用Nexys Video开发板，移植e203 运行FPGA原工程首先进入fpga原工程，如图所示 使用下面命令打开vivado make install...
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GD32VF103芯片的SDK包中有没有像STM32包中有这样核心硬件的内存映射Nuclei Studio中是不是没有查找整个工程的关键词的功能啊，比如搜索一个词，不仅仅只是在当前的文件中搜索，可以在...
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求助：如何下载Package和生成对应的RTL代码？这些视频的内容在哪里能搜索到，谢谢
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各位大佬，想问一下怎么用Nuclei Studio来生成编译后的.verilog文件
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(/uploadfile/editor/0/3/3701.png)
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使用DDR4作为外接存储单元时，蜂鸟e203的访问地址为0x40000000,但是经过vivado的Block design后使用DDR4，在板子上跑测试DDR4读写程序，报store访问异常，不知道...
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系统：Ubuntu20.04Hbird-SDK: 0.1.3工具链: nuclei_riscv_newlibc_prebuilt_linux64_2022.12 我想使用make dasm RISC-...
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如题
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用NucleiStudio往ddr200t开发板下载程序后，每次程序运行一半就卡住。程序tb仿真的时候没有问题，但一上板子就卡住，请问这是什么问题？该如何解决呢？
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在使用Nuclei SDK或者HBird SDK进行下载(upload)或者调试(debug)的时候出现下面这种输出：使用的flash是w25q256FVFIG 求助有啥解决办法？
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使用NucleiStudio调试时，无法从调用函数中跳转回main函数 程序运行到调用函数最后一行时，继续运行会弹出这个界面
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影响程序执行时长的因素有CPI，指令数，主频，如果排除了处理器主频的影响因素，指令数目又是固定的，那评比的不就是CPI了吗，也就是说我把E203改成1个单周期处理器，这种标准下的性能就能提升很多了，...
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以经典的五级流水线为例，如果想要在这个基础上加“一次读多个数据”，“一次写多个数据”的存储访问自定义指令。需要考虑的问题有什么方面？以下是我考虑到的一些方面，欢迎各位大佬多多指点遗漏和不足的地方： 1...
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请问下面几个信号（ICB总线相关）的含义是什么？lsu2biu_icb_cmd_burstlsu2biu_icb_cmd_beatlsu2biu_icb_cmd_excllsu2biu_icb_cmd...
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开发板：正点原子达芬奇Pro开发板FPGA Artix-7 XC7A100T调试器：Sipeed USB-JTAG/TTL RISC-V调试器 OpenOCD报错如下： Open On-Chip De...
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在很长一段时间，CPU架构百花齐放，相互争霸，处于“军阀割据”的状态。新兴处理器（CPU）开源指令集RISC-V的出现，不仅提供除x86与ARM架构之外的新选择，而且是解决这一割据局面的好选择。由于R...
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在使用nucleistudio对whetstone代码进行编译后，查看lst文件发现没有fadd等浮点运算的指令，为什么会有这种结果呢，如果要支持对F/D模块的编译，要怎么办
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蜂鸟E203 e203_ifu_ifetch.v模块中，assign ir_valid_set ifu_rsp_hsked (~pipe_flush_req_real) (~ifu_rsp_ne...
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我用的mcu200t板子，所有的约束都不用改，nucleistudio创建project也是选的flash启动。但是为什么写flash会失败？是因为address错误吗？有没有大神可以帮帮我。。。
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开发板：Nuclei DDR200T FPGA环境：Windows10软件版本：NucleiStudio_IDE_202009试验过程：1、 Gitee下载了开源的mcs文件Vivado烧写至FPGA...
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Error: VVP input file 10.3 can not be run with run time version 12.0 (stable)求助大佬，在/vsim下执行make run_...
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参赛所选用的FPGA开发平台限定于Xilinx FPGA，不得采用内含硬核处理器的FPGA芯片（包括不限于ZYNQ等），具体型号和开发板厂家不限。 芯来科技将为参赛队提供免费的开...
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为了丰富基于Nuclei CPU/SoC IP的软件生态，以及全面提升Nuclei Studio的易用性与扩展性，让客户和开发者能够围绕Nuclei IP做出更完善的RISC-V软硬件一体化解决方案，...
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“逐梦芯时代，青春正当燃”！2023第七届全国大学生集成电路创新创业大赛（下称集创赛）正式开启报名通道。集创赛由工业和信息化部人才交流中心主办，是国内集成电路产学领域最具规模和影响力的赛事，也是入选中...
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为了进一步提升Nuclei Studio NPK包管理功能的稳定性和扩展性，让客户和开发者能够围绕Nuclei Studio做出更完善的Nuclei RISC-V嵌入式软件开发框架，本次Nuclei ...
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我现在没有开发板，请问有什么软件或方法能对hdl语言描述的riscv内核进行仿真，同时接入gdb+openOCD对其进行调试吗？
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队伍名称：对不对队，队伍编号：CICC3054 在移植内核时，用VIVADO进行综合实现后会出现时序违例，如图： 虽然可以上板正常进行开发，但是还是想把这些违例解决下_ 检查后，发现是 apb_ad...
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